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memory barrier ( CPU에서 명령어 실행 순서 보장 )
글쓴이: EzDoum 글쓴날: 2012년 02월 14일 오후 05:03




Quote:
최근 CPU들은 일련의 명령어들은 실행 순서를 변경하여, 자원을 효율적으로 사용하도록 하는 기능들을 지원한다고 합니다. 실행 순서의 변경은 모순된 결과를 초래하지 않는 범위 내에서 변경되도록 하는 것은 당연합니다. 이 경우 단순히 그 CPU 에서의 연산 결과에 모순이 없을 뿐만 아니라 다른 CPU에서 보았을 경우에도 연산 결과에 모순이 있으면 안됩니다. 실제 메모리 상의 데이터는 다른 CPU로 부터 참조나 갱신을 하기 위해 CPU간r의 동일한 데이터를 참조 할 때 그 데이터의 접근 순서를 제대로 지킬 필요가 있습니다. 이 메모리 접근 순서를 제어하기 위한 구조가 메모리 장벽-Memory Barrier 입니다. 예를 들어 메모리를 R,W,R,W,R,W 와 같은 순서로 참조되는 명령에서, CPU는 효율을 높이기 위해서, R,R,R,W,W,W 와 같이 명령을 재 배치 할 수 있는데, 이러한 Re-Ordering 를 막기 위해 Memory Barrier 를 사용합니다. 그리고, Memorry Barier 는 하드웨어적인 방법과 소프트웨어적인 방법이 있습니다. 소스를 좀 보다가 다음과 같은 코드를 보게 되었습니다.


http://lksas4-arm11.springnote.com/pages/899194
http://blog.dasomoli.org/222

그런데 이상한건 사용중인 Cortex-A8은
in-order 아키텍쳐라서 영향을 안 받을 것 같은데, Dual issue가 문제가 되려나.

http://processors.wiki.ti.com/index.php/Cortex-A8_Features#Superscalar_Cortex-A8_Core

Quote:"Superscalar Cortex-A8 Core"
In-order dual instruction issue
less complex than out-of-order
fewer structures means lower power
less need for custom design


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