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임베디드! - SDRAM 관련자료 2
글쓴이: EzDoum 글쓴날: 2005년 09월 27일 오전 12:10
하드웨어



대부분의 프로그래머들에게 SDRAM은 바이오스가 환경설정하고 cpu가 알아서 제어 하지만 언젠가 임베디드 환경에서 SDRAM을 직접 제어하게 된다면 구조를 정확하게 알아야 할 것이다.

아래는 SDRAM을 체계적이고 간결하게 설명한 플래쉬 자료이다.
http://www.corsairmemory.com/memory_basics/153707/index.html


첨부는 SDRAM 관련 자료중에 잘된 것을 모았다.

시작은 ABC_SDRAM.pdf로 하는게 좋다. 그리고 마이크론과 삼성의 데이터북도 같이 넣었는데, sdram command 별로 타이밍도가 상세히 나와있어 sdram 동작을 이해하는데 좋은 자료이다.

  • 첨부 파일: SDRAM.ZIP SDRAM.ZIP (2 MiB(2,613,962 Bytes))

    [분류: 하드웨어 인쇄용 페이지 본문 email로 보내기 ]

  • <  살인적인 일정!! | 임베디드! - CMOS Logic Gate  >
    임베디드! - SDRAM 관련자료 2 | 답장: 4개 | 본문에 답장
    정렬 :  
    답장 EzDoum 2005년 09월 27일 오전 12:50 [ 이글에 답장 | 본문에 답장 | 책갈피 ]
    http://www-inst.eecs.berkeley.edu/~cs150/fa04/Calendar.htm

    온라인 강좌! good!
    http://calinx.eecs.berkeley.edu/lablectures/Fa004/ll9/index.htm#nopreload=1
    http://calinx.eecs.berkeley.edu/lablectures/Fa004/ll10/index.htm#nopreload=1


    [수정]

    답장 EzDoum 2005년 09월 27일 오후 12:08 [ 이글에 답장 | 본문에 답장 | 책갈피 ]
    Lattice Ref. Design(verilog)

    Advanced SDR SDRAM Controller
    Standard SDRAM Controller for ispMACH Devices
    Fast Page Mode SDRAM Controller
    QDR Memory Controller
    DDR SDRAM Controller

    http://www.latticesemi.com/products/devtools/ip/refdesigns/index.cfm
    [수정]

    답장 EzDoum 2005년 10월 21일 오후 03:57 [ 이글에 답장 | 본문에 답장 | 책갈피 ]
    Timing Appearing in Function-Only models

    ● tCK3: Clock cycle time (CAS Latency = 3)
    ● tCK2: Clock cycle time (CAS Latency = 2)
    ● tCK1: Clock cycle time (CAS Latency = 1)
    ● tROH3: Data-out to High-impedance from PRE command (CAS Latency = 3)
    ● tROH2: Data-out to High-impedance from PRE command (CAS Latency = 2)
    ● tROH1: Data-out to High-impedance from PRE command (CAS Latency = 1)
    ● tDQM: DQM to data mask during write
    ● tDQD: DQM to input data delay
    ● tDWD: Write command to input data delay
    ● tDQZ: DQM to data High-impedance during READs
    ● tRC: ACT to ACT/REF command period
    ● tSREX: Self Refresh Exit Time
    ● tRAS: ACT to PRE command period
    ● tRP: PRECHARGE command period
    ● tRCD: ACTIVE to READ/WRITE delay
    ● tRRD: ACT(0) to ACT(1) delay
    ● tCCD: CAS(0) to CAS(0) delay (BANK n to BANK n)
    ● tCBD: CAS(0) to CAS(1) delay (BANK n to BANK m)
    ● tWR: Write recovery time
    ● tDPL3: Data-in to PRE command period (CAS Latency = 3)
    ● tDPL2: Data-in to PRE command period (CAS Latency = 2)
    ● tDPL1: Data-in to PRE command period (CAS Latency = 1)
    ● tDAL3: Data-in to ACT command period (CAS Latency = 3)
    ● tDAL2: Data-in to ACT command period (CAS Latency = 2)
    ● tDAL1: Data-in to ACT command period (CAS Latency = 1)
    ● tRDL: Last data-in to PRE command period
    ● tBDL: Last data-in to BST command period
    ● tCDL: Last data-in to WR/RD command period
    ● tMRD: Load Mode register or Extended Load Mode register to ACT/REF command
    ● tREF: Refresh period (REF-REF command interval)
    ● tRFC: AutoRefresh period
    ● tCKED: CKE to clock disable or power-down entry mode
    ● tPED: CKE to clock enable or power-down exit setup mode
    ● tRAC: RAS access time
    ● tCAC: CAS access time
    ● tBSH: Last data-in to BST command period
    ● tINITIAL: Initial wait if power-on sequence is enabled
    ● tDPD_EXIT_INITIAL_WAIT_TIME: Initial wait period after deep power down exit


    [수정]

    답장 EzDoum 2009년 01월 10일 오후 07:08 [ 이글에 답장 | 본문에 답장 | 책갈피 ]
    http://www.chomdan.co.kr/webzine/etro/2001/06/200106-10699.pdf
    [수정]

    임베디드! - SDRAM 관련자료 2 | 답장: 4개 | 본문에 답장
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